本书按照“器件-软件-设计语言”的顺序介绍数字系统设计的方法、
CPLD/FPGA器件、典型的EDA设计软件和Verilog HDL硬件描述语言,力求涵盖数字系统开发涉及的主要技术,并在内容上进行取舍,做了精心的编排。
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书名 | 数字系统设计与Verilog HDL(第2版)/EDA工具应用丛书 |
分类 | |
作者 | 王金明 |
出版社 | 电子工业出版社 |
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简介 | 编辑推荐 本书按照“器件-软件-设计语言”的顺序介绍数字系统设计的方法、 CPLD/FPGA器件、典型的EDA设计软件和Verilog HDL硬件描述语言,力求涵盖数字系统开发涉及的主要技术,并在内容上进行取舍,做了精心的编排。 内容推荐 本书按照“器件-软件-设计语言”的顺序介绍数字系统设计的方法、CPLD/FPGA器件、典型的EDA设计软件和Verilog HDL硬件描述语言,力求涵盖数字系统开发涉及的主要技术,并在内容上进行取舍,做了精心的编排。 本书以具体的实例,详细介绍用Quartus II、MAX+plus II软件进行原理图设计和文本设计开发的过程,对Synplify Pro/Synplify、ModelSim等专用开发工具的使用与相互接口也做了介绍。 Verilog HDL数字设计是本书的重点,以可综合的设计为重点,同时对仿真和模拟也做了深入阐述,讨论了设计方法和设计优化的问题,以大量经过验证的数字设计实例为依据,全面系统地阐述了Verilog HDL硬件设计开发的方法与技巧。 本书突出的特点是:着眼于实用性,紧密联系教学和科研实际,实例丰富。全书概念清晰,语言流畅,可读性强。书中加入了大量的图和表,以增强表述的效果。 本书可作为电子工程、通信工程、仪器仪表、数字信号处理等专业本科生和研究生的教学用书,也可供从事电路设计和系统开发的工程技术人员阅读参考。 目录 第1章 EDA技术与数字系统设计…………………………………………………(1) 内容提要………………………………………………………………………(1) 1.1 引言……………………………………………………………………(1) 1.2 EDA技术及其发展………………………………………………………(2) 1.3 数字系统的设计技术…………………………………………………(3) l.3.1 Top—down设计………………………………………………(4) 1.3.2 Bottom-up设计………………………………………………(5) 1.3.3 IP复用技术与SoC……………………………………………(5) 1.4 数字系统的实现方式…………………………………………………(6) 1.5 数字系统的设计输入方式……………………………………………(7) 1.6 数字系统设计的流程…………………………………………………(9) 1.6.1 设计输入………………………………………………………(9) 1.6.2 综合……………………………………………………………(10) 1.6.3 适配……………………………………………………………(11) 1.6.4 仿真……………………………………………………………(12) 1.6.5 编程……………………………………………………………(12) 1.7 常用的EDA设计工具……………………………………………………(12) 1.7.1 集成的CPI。D/FPGA开发工具………………………………(12) 1.7.2 设计输入工具…………………………………………………(13) 1.7.3 逻辑综合器……………………………………………………(13) 1.7.4 仿真器…………………………………………………………(14) 1.7.5 版图设计软件及其他常用EDA工具…………………………(15) 习题……………………………………………………………………………(16) 第2章 CPLD/FPGA的结构与配置………………………………………………(17) 内容提要………………………………………………………………………(17) 2.1 概述……………………………………………………………………(17) 2.2 PLD的分类………………………………………………………………(18) 2.2.1 PLD的集成度分类……………………………………………(18) 2.2.2 按编程特点分类………………………………………………(19) 2.2.3 按结构特点分类………………………………………………(20) 2.3 PLD的基本结构…………………………………………………………(20) 2.3.1 PLD器件的基本结构……………………………………………(20) 2.3.2 PLD电路的表示方法……………………………………………(21) 2.3.3 简单PLD的结构…………………………………………………(22) ………… |
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